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基于DSP和以太网的数据采集处理系统
接口、支持片上fifo的突发dma模式·自动设置网络速度和协议的nway功能·可选的eeprom设置，支持1kbit和4kbit的eeprom接口·支持软件eeprom接口，方便升级eeprom的内容图3 dsp和以太网接口部分硬件设计 2.3 系统结构2.3.1 adc数据采集部分cpld1由dsp提供时钟信号，主要作用是提供扫描表sram的地址，扫描表sram的数据由dsp写入。扫描表输出的数据用来设定a/d转换的通道和仪表放大器的增益。adc采用14位的ltc1416。32路模拟信号通过多路复用器后，其中一路信号被选中，进入仪表放大器，放大之后进入adc。adc的转换时钟由dsp的定时器提供。2.3.2 dsp数据处理部分adc转换后的14位数据通过fifo进入dsp进行处理，fifo采用4片cy7c425形成乒乓结构，以实现模拟信号的不间断采样。dsp扩展一片flash memory作为dsp的程序存储器，另外还扩展了一片sram作为程序缓存。脱机运行时，dsp将flash中的程序写入sram，再写入dsp内部ram。cpld2主要用于控制fifo的读写，

LTC1416
采样率：400kSPS；功耗：70mW；保证微分非线性为±1.5LSB，积分非线性为±2LSB(最大值)；80.5dB S/(N＋D)和在100kHz时，93dB总谐波失真；80dB S/(N＋D)和90dB奈奎斯特总谐波失真；噪声和休眠关机模式；内部或外部操作参考；真差分输入抑制共模噪声；15MHz全功率带宽采样；±2.5V双级输入范围；28引脚SSOP封装